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☆ 重慶理工大學(xué)FPGA開發(fā)培訓(xùn)圓滿結(jié)束。[2016-5-3]
☆ 曙海第423期數(shù)字集成電路培訓(xùn)班圓滿結(jié)束。[2016-5-2]
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☆ 上海精澄科技 MATLAB企業(yè)培訓(xùn)圓滿結(jié)束。[2015-12-05]
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☆ 中國科上海微系統(tǒng) 芯片設(shè)計(jì)開發(fā)企業(yè)培訓(xùn)圓滿結(jié)束[2013-11-30]
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☆ 一汽海馬汽車 DSP2000電機(jī)控制企業(yè)培訓(xùn)圓滿結(jié)束[2013-11-21]
☆ 北京航天控制儀器研究所 達(dá)芬奇開發(fā)企業(yè)培訓(xùn)圓滿結(jié)束[2013-11-20]
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曙海成功實(shí)施四川長虹佳華信息產(chǎn)品 MTK開發(fā)企業(yè)培訓(xùn)[2013-9-26]
曙海成功實(shí)施重慶和豐電工器材 WXWORKS開發(fā)企業(yè)培訓(xùn)[2013-9-24]
曙海成功實(shí)施河北省科應(yīng)用數(shù)學(xué)研究所Android開發(fā)企業(yè)培訓(xùn)[2013-9-22]
曙海成功實(shí)施福斯賽諾分析儀器 FPGA系統(tǒng)開發(fā)企業(yè)培訓(xùn)[2013-9-20]
曙海成功實(shí)施株洲田龍鐵道電氣 vxworks開發(fā)企業(yè)培訓(xùn)[2013-9-18]
曙海成功實(shí)施南京國電自動(dòng)化工程 FPGA開發(fā)企業(yè)培訓(xùn)[2013-9-16]
曙海成功實(shí)施北京環(huán)境特性研究所 TI達(dá)芬奇開發(fā)企業(yè)培訓(xùn)[2013-9-14]
曙海成功實(shí)施江蘇金陵科技集團(tuán) Cadence PCB企業(yè)培訓(xùn)[2013-9-10]
曙海成功實(shí)施重慶網(wǎng)視智能流技術(shù) 達(dá)芬奇開發(fā)企業(yè)培訓(xùn)[2013-9-8]
曙海成功實(shí)施成都熊谷加世電器 達(dá)芬奇開發(fā)企業(yè)培訓(xùn)[2013-9-6]
曙海成功實(shí)施先愛生技術(shù)集團(tuán) DSP6000系統(tǒng)開發(fā)企業(yè)培訓(xùn)[2013-9-4]
曙海成功實(shí)施南京南瑞集團(tuán) FPGA數(shù)據(jù)采集企業(yè)培訓(xùn)[2013-9-2]
曙海成功實(shí)施無錫力芯微電子 IC電磁兼容企業(yè)培訓(xùn)[2013-8-28]
曙海成功實(shí)施微小衛(wèi)星工程中心 DM3730軟硬全能開發(fā)企業(yè)培訓(xùn)[2013-8-20]
曙海成功實(shí)施廣州航新航空科技 PowerPC 開發(fā)企業(yè)培訓(xùn)[2011-4-20]
曙海成功實(shí)施桂林航天工業(yè) MATLAB開發(fā)企業(yè)培訓(xùn)[2013-8-10]
曙海成功實(shí)施江蘇五維電子科技 TI達(dá)芬奇開發(fā)企業(yè)培訓(xùn)[2013-8-8]
曙海成功實(shí)施Sony（索尼）LINUX開發(fā)企業(yè)培訓(xùn)
[2011-5-19]
曙海成功實(shí)施奇瑞汽車單片機(jī)開發(fā)企業(yè)培訓(xùn)[2011-4-8]
第89期FPGA應(yīng)用設(shè)計(jì)高級培訓(xùn)班圓滿結(jié)業(yè)
[2011-4-3]
第31期iPhone培訓(xùn)班圓滿結(jié)業(yè)
[2011-3-28]
第67期DSP6000系統(tǒng)開發(fā)培訓(xùn)班圓滿結(jié)業(yè)
[2011-3-25]
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　　集成電路IC SOC設(shè)計(jì)工程師培訓(xùn)班
  課程說明
　本課程講授基于Synopsys EDA tools構(gòu)成的ASIC/SOC數(shù)字電路開發(fā)流程，學(xué)員通過運(yùn)用數(shù)字邏輯、硬件描述語言完成專題項(xiàng)目設(shè)計(jì)，在課程過程中掌握數(shù)字集成電路的coding、仿真、綜合、靜態(tài)時(shí)序分析、驗(yàn)證等一系列數(shù)字電路前端流程中的設(shè)計(jì)技巧，終使學(xué)員達(dá)到能獨(dú)立完成中等規(guī)模電路模塊的前端設(shè)計(jì)水平。模擬前端設(shè)計(jì)當(dāng)中建模、模擬、驗(yàn)證、優(yōu)化，以及模擬電路設(shè)計(jì)中的測試電路技術(shù)，通過多個(gè)專題實(shí)驗(yàn)幫助學(xué)員熟悉IC設(shè)計(jì)流程，提升學(xué)員分析、設(shè)計(jì)、的能力。本課程涵蓋數(shù)字IC設(shè)計(jì)領(lǐng)域相關(guān)技術(shù)的核心內(nèi)容，注重基礎(chǔ)知識和實(shí)用技巧的講解外，還將特別講授國際新的設(shè)計(jì)理念。本課程為IC設(shè)計(jì)高端精華課程，老師將多年實(shí)踐經(jīng)驗(yàn)手把手教授，讓學(xué)員在真實(shí)的項(xiàng)目實(shí)踐環(huán)境中提升技術(shù)水平，熟練使用EDA工具，真正掌握IC設(shè)計(jì)中“漁”的手段.
  培訓(xùn)目標(biāo)

　 幫助學(xué)員熟悉并掌握典型數(shù)字ASIC/SOC芯片前端開發(fā)流程和設(shè)計(jì)技巧，以及相關(guān)設(shè)計(jì)軟件的使用，課程結(jié)束后學(xué)員可積累相當(dāng)于1年左右的實(shí)際工作經(jīng)驗(yàn)，能夠獨(dú)立完成ASIC/SOC中等模塊的設(shè)計(jì)。
   入學(xué)要求

       有數(shù)字電路設(shè)計(jì)和硬件描述語言的基礎(chǔ)或自學(xué)過相關(guān)課程。
   班級規(guī)模及環(huán)境
       為了保證培訓(xùn)效果，增加互動(dòng)環(huán)節(jié)，我們堅(jiān)持小班授課，每期報(bào)名人數(shù)限20人，多余人員安排到下一期進(jìn)行。
   上課時(shí)間和地點(diǎn)
上課地點(diǎn)：【上�！浚和瑵�(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈
近開課時(shí)間(周末班/連續(xù)班/晚班）：IC設(shè)計(jì)工程師培訓(xùn)班：2024年12月30日......(歡迎您垂詢，視教育質(zhì)量為生命！)
   學(xué)時(shí)
　    ◆課時(shí)： 1個(gè)月時(shí)間

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   師資團(tuán)隊(duì)
【趙老師】

大規(guī)模集成電路設(shè)計(jì)專家，10多年超大規(guī)模電路SOC芯片設(shè)計(jì)和版圖設(shè)計(jì)經(jīng)驗(yàn)，參與過DSP、GPU、DTV、WIFI、手機(jī)芯片、物聯(lián)網(wǎng)芯片等芯片的研發(fā)。精通CMOS工藝流程、版圖設(shè)計(jì)和布局布線，精通SOC芯片 設(shè)計(jì)和版圖設(shè)計(jì)的各種EDA工具（如：DC/Prime Time/Encounter/Virtuoso/Calibre/Dracula/Assura），具有豐富的SOC芯片設(shè)計(jì)、驗(yàn)證、DFT、PD、流片經(jīng)驗(yàn)。
熟練掌握版圖設(shè)計(jì)規(guī)則并進(jìn)行驗(yàn)證及修改；熟練掌握Unix/Linux操作系統(tǒng)；熟悉CMOS設(shè)計(jì)規(guī)則、物理設(shè)計(jì)以及芯片的生產(chǎn)流程與封裝。

【王老師】

資深I(lǐng)C工程師，十幾年集成電路IC設(shè)計(jì)經(jīng)驗(yàn)，精通chip的規(guī)劃、數(shù)字layout、analog layout和特殊電路layout。先后主持和參與了近三百顆CHIP的設(shè)計(jì)與版圖Layout工作,含MCU芯片、DSP芯片、LED芯片、視頻芯片、GPU芯片、通信芯片、LCD芯片、網(wǎng)絡(luò)芯片、手機(jī)芯片等等。
從事過DAC、ADC、RF、OP、PLL、PLA、LNA、ESD、ROM、RAM等多種制程analog&digital的電路IC設(shè)計(jì)，
熟練掌握1.8V，3.3V,5V,18V,25V，40V等各種高低壓混合電路的IC設(shè)計(jì)。

【張老師】

從事數(shù)字集成電路設(shè)計(jì)10余年，精通CMOS工藝流程、版圖設(shè)計(jì)和布局布線，精通VERILOG,VHDL語言，
擅長芯片前端設(shè)計(jì)和復(fù)雜項(xiàng)目實(shí)施的規(guī)劃管理，其領(lǐng)導(dǎo)開發(fā)的芯片已成功應(yīng)用于數(shù)個(gè)國際知名芯片廠商之產(chǎn)品中。豐富的芯片開發(fā)經(jīng)驗(yàn)，對于現(xiàn)今主流工藝下的同步數(shù)字芯片設(shè)計(jì)技術(shù)和流程有良好把握。長期專注于內(nèi)存控制器等產(chǎn)品的研發(fā)，擁有數(shù)顆規(guī)模超過百萬門的數(shù)字芯片成功流片經(jīng)驗(yàn).

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   質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費(fèi)提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會。 。專注高端培訓(xùn)13年，曙海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。
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遠(yuǎn)程在線培訓(xùn)
  集成電路IC設(shè)計(jì)工程師培訓(xùn)班

        本課程實(shí)戰(zhàn)演練使用Synopsys公司的DC,PT等工具，
和Cadence公司的Encounter,Virtuoso等工具，多工具聯(lián)合從頭至尾強(qiáng)化練習(xí)整個(gè)芯片的生成過程，強(qiáng)調(diào)實(shí)戰(zhàn)，實(shí)戰(zhàn)，還是實(shí)戰(zhàn)！

        免費(fèi)、無保留贈(zèng)送，教學(xué)過程中使用的Synopsys公司和Cadence公司的全套工具和安裝方法，而且還贈(zèng)送已經(jīng)在VMware Linux下安裝好的Synopsys公司和Cadence公司的全套工具（這套工具非常珍貴，費(fèi)了老師很多心血才全部安裝好），讓您隨時(shí)隨地，打開電腦就能進(jìn)行芯片的設(shè)計(jì)和練習(xí)！
IC工具虛擬機(jī)
第一階段 集成電路前端設(shè)計(jì)
1.邏輯設(shè)計(jì)理論
2.Verilog語言
3.VHDL語言
4.數(shù)字電路驗(yàn)證
1)驗(yàn)證平臺的建立
2）功能測試
5.設(shè)計(jì)綜合（synthesys）
6.流片生成
7.仿真測試
8.靜態(tài)時(shí)序分析(STA)
9.數(shù)字前端全流程設(shè)計(jì)工具
10.相關(guān)工藝庫文件計(jì)算機(jī)操作系統(tǒng)UNIX應(yīng)用；
11.數(shù)字電路邏輯設(shè)計(jì)；
12.硬件描述語言HDL和邏輯綜合初步；
13.集成電路設(shè)計(jì)流程；

14.IC設(shè)計(jì)原理；
15. 數(shù)字系統(tǒng)設(shè)計(jì)與FPGA現(xiàn)成集成；16.RTL驗(yàn)證；
靜態(tài)時(shí)序分析（STA）；
邏輯綜合（Logic Synthesis）；
軟硬件協(xié)同設(shè)計(jì)仿真；

第二階段 數(shù)字集成電路后端設(shè)計(jì)
1.Floor plan
2.電源規(guī)劃
3.布局、擺放
4.時(shí)鐘樹
5.布線
6.Floor Plan
7.靜態(tài)時(shí)序分析（PT）
8.驗(yàn)證
9.實(shí)戰(zhàn)
10.數(shù)字后端全流程設(shè)計(jì)工具
11.相關(guān)工藝庫文件
12.工藝庫和工具的結(jié)合；
13.集成電路設(shè)計(jì)流程；
14.PrimeTime驗(yàn)證流程；
15.primtetime設(shè)置；
16.primtetime實(shí)踐
17.CMOS集成電路設(shè)計(jì)原理；
18.IC設(shè)計(jì)概論；
19.IC布局布線設(shè)計(jì)；
20.驗(yàn)證；
21.可測性設(shè)計(jì)；
22.設(shè)計(jì)實(shí)踐。
第三階段 數(shù)字集成電路數(shù)據(jù)高級－－Verification測試

Verification平臺建立/功能測試

1） 驗(yàn)證環(huán)節(jié)在ic設(shè)計(jì)流程中的位置，
2) RTL/網(wǎng)表/FPGA 的驗(yàn)證階段
3) 驗(yàn)證關(guān)鍵
4)　verification 的方法
5) 　RTL verification testbench
6) 　RTL語言要點(diǎn)
7) 　驗(yàn)證流程
第四階段 數(shù)字集成電路后端數(shù)據(jù)高級－－設(shè)計(jì)綜合（synthesys）
1）綜合
綜合的概念　
綜合庫與工具介紹　
綜合的過程　
約束／工作環(huán)境的設(shè)立　
工業(yè)庫與綜合工具的結(jié)合
綜合面積
2）綜合設(shè)計(jì)的導(dǎo)出
導(dǎo)出網(wǎng)表
導(dǎo)出時(shí)序文件
第五階段 數(shù)字集成電路后端數(shù)據(jù)高級－－時(shí)序分析（PT）
1)PT概念
2)PT環(huán)境設(shè)置
3)TCL腳本的編寫　
4)TCL腳本的使用
5)時(shí)序分析
6)關(guān)鍵設(shè)置　
7)報(bào)告分析　
第六階段
1、代碼編寫及仿真技巧
系統(tǒng)介紹verilog語法規(guī)范、語言與電路實(shí)現(xiàn)之關(guān)系，以及RTL仿真技術(shù)、RTL代碼編寫技巧、控制單元和數(shù)據(jù)通路單元的實(shí)現(xiàn)技巧、基于Verilog語言的測試編碼技巧，功能驗(yàn)證及Testbench搭建的技巧。


2、綜合技術(shù)
講述綜合基礎(chǔ)、組合電路與時(shí)序電路、基于TCL的綜合流程、綜合策略、設(shè)計(jì)環(huán)境和設(shè)計(jì)約束的制定、綜合優(yōu)化的技巧、實(shí)現(xiàn)優(yōu)化結(jié)果的可綜合代碼編寫技術(shù)等。

3、時(shí)序分析技術(shù)
基于Synopsys PT的靜態(tài)時(shí)序分析技術(shù)，介紹靜態(tài)時(shí)序分析、基于TCL技術(shù)的處理過程和常用的時(shí)序分析方法。
 
第七階段 ARM 芯片SOC設(shè)計(jì)項(xiàng)目實(shí)戰(zhàn)強(qiáng)化

1.架構(gòu)及設(shè)計(jì)流程

2.CPU核

3.指令

4.中斷和異常

5.數(shù)據(jù)緩沖和指令緩沖

6.內(nèi)部數(shù)據(jù)ram和指令RAM

7.總線

8.中斷


曙海教育實(shí)驗(yàn)設(shè)備
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本課程部分實(shí)驗(yàn)室實(shí)景
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.(2014年7月11)..........................................................................................................